据产业链研究机构 SemiAnalysis 最新机构报告，已下调其下一代“Rubin”架构 GPU 所配套 HBM4 高带宽显存的性能要求，原因在于主要供应商 SK hynix 与三星难以在量产阶段达到英伟达原先设定的激进带宽目标。
原计划中，“Vera Rubin”芯片的总显存带宽目标为 22 TB/s，但从当前供货节奏和良率状况来看，首批系统预计只能实现约 20 TB/s 左右，对应 HBM4 每针速率约为 10 Gbps，这意味着英伟达对这一代加速卡的升级节奏被迫“踩刹车”，最终性能指标将较此前公开口径略有回调。
此前，英伟达为“Vera Rubin”VR200 NVL72 系统设定的官方带宽目标经历了多次上调：在 2025 年 3 月时，目标为 13 TB/s，到了当年 9 月便提升至 20.5 TB/s。 在 2026 年 CES 上，英伟达曾对外确认 VR200 NVL72 系统已实现 22 TB/s 带宽，并以此作为对标 AMD Instinct MI455X 加速卡的重要卖点——后者的系统带宽为 19.6 TB/s，英伟达原本处于略低水平，通过更高速的 DRAM 以及 CPU、GPU 与整机之间互连架构的改进，才实现了“反超”。 然而随着 SK hynix 与在量产 HBM4 时难以稳定支撑这一规格，VR200 全系统在实际部署阶段很可能将以约 20 TB/s 的总带宽出货，而非此前宣称的 22 TB/s。
在供应体系方面，另一家存储大厂美光则基本退出了“Vera Rubin”平台 HBM4 供应阵容。 机构渠道流出的 SemiAnalysis 笔记显示，在 VR200 NVL72 系统的 HBM4 供货中，SK hynix 预计将占据约 70% 的份额，其余约 30% 则由三星提供；对于美光，目前并无为该系统提供 HBM4 的承诺或规划。 不过，美光仍将在“Vera”系列 CPU 上扮演重要角色：它将为这些处理器提供 LPDDR5X 内存，单颗 CPU 最高可配置至 1.5 TB 容量，在一定程度上以更大容量、不同形态的内存方案，弥补其在 HBM4 业务上错失的份额。
整体来看，在 AI 与高性能计算对显存带宽和容量需求持续飙升的背景下，英伟达原本试图通过“Vera Rubin”平台在带宽指标上明显压制竞品，但现实中的工艺与供应链瓶颈，使得 22 TB/s 的目标难以在短期内成为量产常态，只能先行以 20 TB/s 左右的折中规格推向市场。 而在 HBM4 供应商结构重新划分的同时，LPDDR5X 在“Vera”CPU 侧的角色也随之被放大，成为英伟达在系统整体内存带宽与容量设计中不可忽视的一环。
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